tailieunhanh - Bài giảng Thiết kế logic số (VLSI Design): Chương II/2.2

Bài giảng Thiết kế logic số (VLSI Design) - Chương II: Ngôn ngữ VHDL (phần ) trình bày về kiến trúc kiểu cấu trúc, mô phỏng trên ModelSim, đối tượng dữ liệu và kiểu dữ liệu. Đây là tài liệu tham khảo hữu ích cho bạn đọc học tập và nghiên cứu môn học Kỹ thuật xung số. Chúc bạn học tốt. | Thiết kế logic số (VLSI design) Bộ môn KT Xung, số, VXL quangkien82@ 08/2012 Nội dung: Kiến trúc kiểu cấu trúc, Mô phỏng trên ModelSim, Đối tượng dữ liệu, kiểu dữ liệu Thời lượng: 3 tiết bài giảng 2/15 Chương II: Ngôn ngữ VHDL quangkien82@ Mục đích, nội dung 3/15 Chương II: Ngôn ngữ VHDL quangkien82@ Adder 4 bit Một thực thể có bao nhiêu kiến trúc ? Kiến trúc nào được biên dịch vào thư viện Work? Kiến trúc nào sẽ được mô phỏng bằng lệnh Vsim? 4/15 Chương II: Ngôn ngữ VHDL quangkien82@ Configuration ADDER4 = 4 Full_adder Behavioral Dataflow configuration behav of adder4 is for structure -- one of architecture for all: full_adder use entity (behavioral); end for; end for; end configuration; -- select architecture for u0: full_adder use entity (behavioral); for u1: full_adder use entity (behavioral); for u2: full_adder use entity . | Thiết kế logic số (VLSI design) Bộ môn KT Xung, số, VXL quangkien82@ 08/2012 Nội dung: Kiến trúc kiểu cấu trúc, Mô phỏng trên ModelSim, Đối tượng dữ liệu, kiểu dữ liệu Thời lượng: 3 tiết bài giảng 2/15 Chương II: Ngôn ngữ VHDL quangkien82@ Mục đích, nội dung 3/15 Chương II: Ngôn ngữ VHDL quangkien82@ Adder 4 bit Một thực thể có bao nhiêu kiến trúc ? Kiến trúc nào được biên dịch vào thư viện Work? Kiến trúc nào sẽ được mô phỏng bằng lệnh Vsim? 4/15 Chương II: Ngôn ngữ VHDL quangkien82@ Configuration ADDER4 = 4 Full_adder Behavioral Dataflow configuration behav of adder4 is for structure -- one of architecture for all: full_adder use entity (behavioral); end for; end for; end configuration; -- select architecture for u0: full_adder use entity (behavioral); for u1: full_adder use entity (behavioral); for u2: full_adder use entity (dataflow); for u3: full_adder use entity (dataflow); ? 5/15 Chương II: Ngôn ngữ VHDL quangkien82@ Configuration 6/15 Chương II: Ngôn ngữ VHDL quangkien82@ Object Types Đối tượng dữ liệu Hằng là những đối tượng dữ liệu dùng khởi tạo để chứa các giá trị xác định trong quá trình thực hiện. Hằng có thể được khai báo trong các gói, thực thể, kiến trúc, chương trình con, các khối và quá trình. Biến là những đối tượng dữ liệu dùng để chứa các kết quả trung gian, biến chỉ có thể được khai báo bên trong các quá trình hoặc chương trình con. Tín hiệu là các đối tượng dữ liệu dùng để kết nối giữa các quá trình (khối logic) hoặc để đồng bộ các quá trình 7/15 Chương II: Ngôn ngữ VHDL quangkien82@ Object Types 8/15 Chương II: Ngôn ngữ VHDL quangkien82@ Data types Name Value Driver Strength ‘U’ Unsolved - 'X' X Strong '0' 0 Strong '1' 1 Strong 'Z' High impedance - 'W' X Weak 'L' 0 Weak 'H' 1 Weak '-' Don’t care - STD_LOGIC_1164 9/15 Chương II: Ngôn ngữ .

• Điện - Điện tử
• Thiết kế logic số
• Bài giảng Kỹ thuật xung
• Kỹ thuật xung
• Thiết kế logic số Chương II
• Ngôn ngữ VHDL
• Mô phỏng trên ModelSim
• Thiết kế mạch logic số chương 3
• Thiết kế mạch logic số
• Thiết kế các khối logic tổ hợp
• Thiết kế các khối logic tuần tự
• Logic tuần tự
• Logic tổng hợp
• Bài giảng Thiết kế mạch logic
• Thiết kế mạch logic
• Toán logic
• Mạch điện tử
• Mạch logic tổ hợp
• Phân tích mạch logic tổ hợp
• Thiết kế mạch logic tổ hợp
• Mạch số học
• logic số
• khái niệm logic số
• định nghĩa logic số
• bài tập logic số
• ứng dụng logic số
• Thiết kế mạch logic số chương 1
• Mạch logic số
• Thiết kế mạch
• Vi mạch số tích hợp
• Yêu cầu đối với thiết kế logic
• Kiến trúc của các IC khả trình
• Thực hành thiết kế logic số Bài 1
• Thực hành thiết kế logic số
• Mô phỏng VHDL trên ModelSim
• Chương trình mô phỏng Modelsim
• Tài liệu thiết kế logic số
• Thực hành thiết kế logic số Bài 2
• Xây dựng bộ cộng trừ
• Khối cộng đơn giản
• Khối dịch và thanh ghi dịch
• Thanh ghi dịch
• Giáo trình Thiết kế logic số
• Mạch logic tuần tự
• Ngôn ngữ mô tả phần cứng VHDL
• Thiết kế các khối mạch dãy
• Thiết kế mạch logic số chương 4
• Thiết kế vi mạch số trên FPGA
• Quy trình thiết kế FPGA
• Thiết kế FPGA
• Bài tập thiết kế FPGA
• Bài giảng Thiết kế logic số
• Công nghệ logic khả trình
• Phƣơng pháp thiết lập cấu hình
• Thiết kế hệ thống số
• Thực hành FPGA bằng Xilin ISE
• Thực hành FPGA bằng Kit SPARTAN 3E
• Cổng logic cơ bản
• Các tham số chính
• Thiết kế các khối số
• Thiết kế số
• Thiết kế các khối nhớ
• Máy trạng thái hữu hạn
• Thiết kế mạch logic số Chương 5
• Thiết kế vi mạch
• Thư viện cổng chuẩn
• Công nghệ chế tạo IC
• Quy trình thiết kế ASIC
• Khối chia số nguyên có dấu
• Khối chia số nguyên không dấu
• Định dạng số thực
• Số thực dấu phảy động
• Thiết kế các mạch số thông dụng
• Định dạng số thực trong thiết kế số
• Mạch nhân số thực dấu phảy động
• Lecture Digital Logic & Design
• Digital logic design
• Analysis of logic circuits
• Boolean Analysis of circuit
• Simplified logic circuit
• Sequential logic
• Logic symbols
• Timing diagrams
• Khối cộng thấy nhớ trước
• Khối dịch không sử dụng toán tử
• Thuật toán cộng dịch trái
• Mã hóa Booth
• Toán tử logic
• Phép dịch không sử dụng toán tử
• Tái cấu hình cho FPGA
• Hoạt động của FPGA
• Kiến trúc của Configurable Logic Blocks
• Thiết kế mạch số trên FPGA
• Kiến trúc Xilinx FPGA
• Quy trình thiết kế trên FPGA
• Dedicated Multiplier