tailieunhanh - Bài giảng Thiết kế logic số (VLSI design): Chương 3.4 - Trịnh Quang Kiên

Bài giảng Thiết kế logic số (VLSI design): Chương trình bày một số nội dung về thiết kế các khối nhớ và máy trạng thái hữu hạn. Ngoài ra, cuối bài giảng cung cấp các bài tập trắc nghiệm để người học có thể nắm bắt được các kiến thức cơ bản của bài giảng. | 9/23/2013 1/15 quangkien82@ Thiết kế logic số (VLSI design) Bộ môn KT Xung, số, VXL quangkien82@ 08/2012 9/23/2013 2/15 quangkien82@ Nội dung: Thiết kế các khối nhớ, máy trạng thái hữu hạn Thời lượng: 3 tiết bài giảng Yêu cầu: Sinh viên có sự chuẩn bị sơ bộ trước nội dụng bài học. Mục đích, nội dung 9/23/2013 3/15 quangkien82@ ROM 9/23/2013 4/15 quangkien82@ RAM Thành phần gây trễ chủ chốt ? Decoder 9/23/2013 5/15 quangkien82@ MEMORY DECODER Đặc điểm: Tốc độ tỷ lệ thuận với dung lượng!!! Đánh giá tài nguyên và tốc độ decoder cấu trúc RAM 1D kích thước 8*8 = 64? Tài nguyên = (M*N)*log2(M*N) = 384cổng Độ trễ = log2() = 6 levels Nhiệm vụ, trỏ đúng địa chỉ ô nhớ cần truy cập!!! 9/23/2013 6/15 quangkien82@ MEMORY DECODER Đánh giá tài nguyên và tốc độ decoder cấu trúc RAM 2D kích thước 8*8? Tài nguyên = M*log2(M) + N*log2(N) + M*N = 112 cổng Độ trễ = 1 + Max (log2(N), | 9/23/2013 1/15 quangkien82@ Thiết kế logic số (VLSI design) Bộ môn KT Xung, số, VXL quangkien82@ 08/2012 9/23/2013 2/15 quangkien82@ Nội dung: Thiết kế các khối nhớ, máy trạng thái hữu hạn Thời lượng: 3 tiết bài giảng Yêu cầu: Sinh viên có sự chuẩn bị sơ bộ trước nội dụng bài học. Mục đích, nội dung 9/23/2013 3/15 quangkien82@ ROM 9/23/2013 4/15 quangkien82@ RAM Thành phần gây trễ chủ chốt ? Decoder 9/23/2013 5/15 quangkien82@ MEMORY DECODER Đặc điểm: Tốc độ tỷ lệ thuận với dung lượng!!! Đánh giá tài nguyên và tốc độ decoder cấu trúc RAM 1D kích thước 8*8 = 64? Tài nguyên = (M*N)*log2(M*N) = 384cổng Độ trễ = log2() = 6 levels Nhiệm vụ, trỏ đúng địa chỉ ô nhớ cần truy cập!!! 9/23/2013 6/15 quangkien82@ MEMORY DECODER Đánh giá tài nguyên và tốc độ decoder cấu trúc RAM 2D kích thước 8*8? Tài nguyên = M*log2(M) + N*log2(N) + M*N = 112 cổng Độ trễ = 1 + Max (log2(N), log2(M) = 4 levels 9/23/2013 7/15 quangkien82@ FIFO- First In First Out Ứng dụng Ưu điểm so với RAM thông thường? - Đơn giản khi sử dụng (không có cổng địa chỉ) Nhược điểm ? - Khó thiết kế - Không truy cập được dữ liệu ngẫu nhiên Khối đệm truyền nhận Đồng bộ hóa các miền làm việc với clock khác nhau 9/23/2013 8/15 quangkien82@ FIFO (Based on Dual Port RAM) 9/23/2013 9/15 quangkien82@ FIFO OPERATON Reset: RP = 0, WP = 0, dataCNT = 0 WRITE: RP = RP, WP = WP + 1, dataCNT = dataCNT + 1 9/23/2013 10/15 quangkien82@ READ: RP = RP+1, WP = WP, dataCNT = dataCNT -1 FIFO OPERATON 9/23/2013 11/15 quangkien82@ READ, WRITE: RP = RP+1, WP = WP +1, dataCNT = dataCNT FIFO OPERATON 9/23/2013 12/15 quangkien82@ READ: RP = RP+1, WP = WP dataCNT = dataCNT - 1 FIFO OPERATON 9/23/2013 13/15 quangkien82@ LIFO – Last In First Out Ứng dụng Stack 9/23/2013 14/15 quangkien82@ FSM-UART Giao thức UART 9/23/2013 15/15 quangkien82@ .

• Kĩ thuật Viễn thông
• Thiết kế logic số
• Bài giảng Thiết kế logic số
• Thiết kế các khối số
• Thiết kế số
• Thiết kế các khối nhớ
• Máy trạng thái hữu hạn
• Thiết kế mạch logic số chương 3
• Thiết kế mạch logic số
• Thiết kế các khối logic tổ hợp
• Thiết kế các khối logic tuần tự
• Logic tuần tự
• Logic tổng hợp
• Bài giảng Thiết kế mạch logic
• Thiết kế mạch logic
• Toán logic
• Mạch điện tử
• Mạch logic tổ hợp
• Phân tích mạch logic tổ hợp
• Thiết kế mạch logic tổ hợp
• Mạch số học
• logic số
• khái niệm logic số
• định nghĩa logic số
• bài tập logic số
• ứng dụng logic số
• Thiết kế mạch logic số chương 1
• Mạch logic số
• Thiết kế mạch
• Vi mạch số tích hợp
• Yêu cầu đối với thiết kế logic
• Kiến trúc của các IC khả trình
• Thực hành thiết kế logic số Bài 1
• Thực hành thiết kế logic số
• Mô phỏng VHDL trên ModelSim
• Chương trình mô phỏng Modelsim
• Tài liệu thiết kế logic số
• Thực hành thiết kế logic số Bài 2
• Xây dựng bộ cộng trừ
• Khối cộng đơn giản
• Khối dịch và thanh ghi dịch
• Thanh ghi dịch
• Giáo trình Thiết kế logic số
• Mạch logic tuần tự
• Ngôn ngữ mô tả phần cứng VHDL
• Thiết kế các khối mạch dãy
• Thiết kế mạch logic số chương 4
• Thiết kế vi mạch số trên FPGA
• Quy trình thiết kế FPGA
• Thiết kế FPGA
• Bài tập thiết kế FPGA
• Công nghệ logic khả trình
• Phƣơng pháp thiết lập cấu hình
• Thiết kế hệ thống số
• Thực hành FPGA bằng Xilin ISE
• Thực hành FPGA bằng Kit SPARTAN 3E
• Cổng logic cơ bản
• Các tham số chính
• Thiết kế mạch logic số Chương 5
• Thiết kế vi mạch
• Thư viện cổng chuẩn
• Công nghệ chế tạo IC
• Quy trình thiết kế ASIC
• Khối chia số nguyên có dấu
• Khối chia số nguyên không dấu
• Định dạng số thực
• Số thực dấu phảy động
• Thiết kế các mạch số thông dụng
• Định dạng số thực trong thiết kế số
• Mạch nhân số thực dấu phảy động
• Lecture Digital Logic & Design
• Digital logic design
• Analysis of logic circuits
• Boolean Analysis of circuit
• Simplified logic circuit
• Sequential logic
• Logic symbols
• Timing diagrams
• Khối cộng thấy nhớ trước
• Khối dịch không sử dụng toán tử
• Thuật toán cộng dịch trái
• Mã hóa Booth
• Ngôn ngữ VHDL
• Toán tử logic
• Phép dịch không sử dụng toán tử
• Tái cấu hình cho FPGA
• Hoạt động của FPGA
• Kiến trúc của Configurable Logic Blocks
• Thiết kế mạch số trên FPGA
• Kiến trúc Xilinx FPGA
• Quy trình thiết kế trên FPGA
• Dedicated Multiplier